在电子线路的分析计算中,哪些因素可以忽略,哪些因素不能忽略?

  在线路的分析计算中,经常根据工程观点,采用近似的计算方法。这是为了简化复杂的实际问题,突出主要矛盾,使分析计算得以比较顺利地进行。在这里,过分追求严密,既无必要,也不可能。但是,近似计算又必须是合理的,必须满足工程上对计算精度的要求。例如,在固定偏置的放大电路中,偏置电流如Vcc=12V,VBEQ=0.7V,则相对于Vcc,在计算时完全可以略去VBEQ,而认为这样做,计算误差小于10%,满足工程要求。但是,如果 是两个数值较大而又比较接近的电流之差:此时第一个除式中的VBEQ就不能忽略,而且两个除式的计算都要比较精确,要有较多的有效数字位数,否则会得出不合理的结果。又如,在求两个电阻并联后的总电阻时,如果一个电阻比另一个大10倍以上,则可认为总电阻近似等于较小的电阻,这样的近似计算误差也不大于10%。再如,在求放大电路的输出电阻时,管子的rec往往是和一个比它小得多的电阻(例如RC)并联。这时,因为rce>>Rc,在并联时rce就可略去 ,而认为输出电阻RO≈Rc。但是,在晶体管恒流源中,如果略去管子的rce,则恒流源的输出电阻Ro。在这里,rce是和一个无限大的电阻并联,当然就不能略去。一个电阻是否可忽略,要看它和其它电阻相比所起作用的大小。

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  在线路的分析计算中,经常根据工程观点,采用近似的计算方法。这是为了简化复杂的实际问题,突出主要矛盾,使分析计算得以比较顺利地进行。在这里,过分追求严密,既无必要,也不可能。但是,近似计算又必须是合理的,必须满足工程上对计算精度的要求。例如,在固定偏置的放大电路中,偏置电流如Vcc=12V,VBEQ=0.7V,则相对于Vcc,在计算时完全可以略去VBEQ,而认为这样做,计算误差小于10%,满足工程要求。但是,如果 是两个数值较大而又比较接近的电流之差:此时第一个除式中的VBEQ就不能忽略,而且两个除式的计算都要比较精确,要有较多的有效数字位数,否则会得出不合理的结果。又如,在求两个电阻并联后的总电阻时,如果一个电阻比另一个大10倍以上,则可认为总电阻近似等于较小的电阻,这样的近似计算误差也不大于10%。再如,在求放大电路的输出电阻时,管子的rec往往是和一个比它小得多的电阻(例如RC)并联。这时,因为rce>>Rc,在并联时rce就可略去 ,而认为输出电阻RO≈Rc。但是,在晶体管恒流源中,如果略去管子的rce,则恒流源的输出电阻Ro。在这里,rce是和一个无限大的电阻并联,当然就不能略去。一个电阻是否可忽略,要看它和其它电阻相比所起作用的大小。

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